JPH0583180B2 - - Google Patents

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JPH0583180B2
JPH0583180B2 JP62087771A JP8777187A JPH0583180B2 JP H0583180 B2 JPH0583180 B2 JP H0583180B2 JP 62087771 A JP62087771 A JP 62087771A JP 8777187 A JP8777187 A JP 8777187A JP H0583180 B2 JPH0583180 B2 JP H0583180B2
Authority
JP
Japan
Prior art keywords
pad electrode
wiring
insulating film
conductive wire
layer
Prior art date
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Expired - Lifetime
Application number
JP62087771A
Other languages
English (en)
Other versions
JPS63252433A (ja
Inventor
Akinori Shimizu
Misao Saga
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fuji Electric Co Ltd
Original Assignee
Fuji Electric Co Ltd
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Filing date
Publication date
Application filed by Fuji Electric Co Ltd filed Critical Fuji Electric Co Ltd
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Publication of JPS63252433A publication Critical patent/JPS63252433A/ja
Publication of JPH0583180B2 publication Critical patent/JPH0583180B2/ja
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    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
    • H10W72/90Bond pads, in general
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
    • H10W72/90Bond pads, in general
    • H10W72/931Shapes of bond pads
    • H10W72/934Cross-sectional shape, i.e. in side view
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
    • H10W72/90Bond pads, in general
    • H10W72/951Materials of bond pads
    • H10W72/952Materials of bond pads comprising metals or metalloids, e.g. PbSn, Ag or Cu

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  • Wire Bonding (AREA)

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、半導体基板上に絶縁膜を介して積層
される複数層の配線を有し、その配線に設けられ
るパツド電極と端子導体とが導線によつて接続さ
れる半導体装置の製造方法に関する。
〔従来の技術〕
多層配線を有し、ワイヤ方式で絶縁基板上に実
装される半導体基板のワイヤボンデイングのため
のパツド電極は、従来最上層の配線の一部に形成
されていた。しかしこのようなパツド電極に導線
をボンデイングした場合、導線とボンデイング部
の下に存在する配線導体膜および酸化物のような
無機絶縁物あるいは有機絶縁物からなる層間絶縁
膜の積層体との弾性率、熱膨張係数の相違によ
り、接合面での剥離が生じやすく、断面の原因と
なるという問題点があつた。
〔発明が解決しようとする問題点〕
本発明は、上述の問題点を解決して、端子導体
と接続される導線と半導体基板上の配線に設けら
れたパツド電極と接合面における剥離などによる
断線のおそれのない、信頼性の高い半導体装置の
製造方法を提供することを目的とする。
〔問題点を解決するための手段〕
この目的は本発明によれば、半導体基板上に絶
縁層を介して形成される第一層目の配線にパツド
電極を設け、次いでそのパツド電極を露出させて
層間絶縁膜を堆積し、上層の配線形成の際に該パ
ツド電極部上に上層の配線金属で積層することを
繰り返し、表面保護膜を積層した後パツド電極に
導線を接続することにより達成される。
〔作用〕
本発明においては、半導体基板上に直接絶縁膜
を介して形成されたパツド電極に導線が形成さ
れ、その中間には積層体が介在せず、またパツド
電極は複数の金属層で積層形成される。
〔実施例〕
次に本発明の実施例を図面について説明する。
図は、本発明の一実施例の半導体装置を示す。
シリコン基板1の上面は薄い酸化膜2で覆われ、
この基板1にはバイポーラトランジスタあるいは
MOSFETなどの半導体素子が集積されていて、
その部分は厚い絶縁膜3で覆われている。次に酸
化膜2および絶縁膜3の上にAl膜を蒸着し、パ
ターニングして第一層配線4を形成する。同時に
絶縁膜3の上に延長された配線の端部にパツド電
極5を形成する。続いて酸化膜、塗布膜などの層
間絶縁膜6を被覆し、スルーホール部7およびパ
ツド電極5上の絶縁膜をエツチング除去した後、
第二層配線8を形成するとともに、パツド電極5
上に第二層配線金属で作られた電極9を重ね形成
する。第二層配線8とパツド電極5との接続は第
一層配線4に達するスルーホール部7を介して行
われる。さらに表面にパツシベーシヨン膜10を
被着し、同様にパツド電極5およびその上に重ね
た電極9を覆う部分を除去する。
図に示したような半導体装置の実装は、図に示
していない絶縁基板上にろう付けなどにより固着
したのち、パツド電極5と絶縁基板上の端子導体
とを導線でボンデイングすることによつて接続す
ることにより行う。
〔発明の効果〕
本発明によれば、ワイヤ方式で実装される多層
配線構造の半導体装置のパツド電極を第一層目の
配線に設けることにより、パツド電極にボンデイ
ングされる接続導線の下に弾性率、熱膨張係数の
異なる積層体がなくなるとともに、パツド電極が
複数層積層したもので形成されるため導線接合面
に生ずる応力が小さくなり、接合面における剥離
が阻止されるので、ICチツプなどを実装した半
導体装置の信頼性を向上させることができる。
【図面の簡単な説明】
図は、本発明の一実施例による半導体装置の要
部断面図である。 1……シリコン基板、2……酸化膜、3……絶
縁膜、4……第一層配線、5……パツド電極、6
……層間絶縁膜、7……スルーホール部、8……
第二層配線、9……電極、10……パツシベーシ
ヨン膜。

Claims (1)

    【特許請求の範囲】
  1. 1 半導体基板上に絶縁膜を介して積層される複
    数層の配線を有し、該配線に設けられるパツド電
    極と端子導体とが導線によつて接続される半導体
    装置の製造方法において、半導体基板上に絶縁膜
    を介して形成される第一層目の配線にパツド電極
    を設け、次いで該パツド電極を露出させて層間絶
    縁膜を堆積し、上層の配線形成の際に該パツド電
    極部上に、該上層の配線金属で積層することを繰
    り返し、表面保護膜を積層した後、パツド電極に
    導線を接続することを特徴とする半導体装置の製
    造方法。
JP62087771A 1987-04-08 1987-04-08 半導体装置の製造方法 Granted JPS63252433A (ja)

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JP62087771A JPS63252433A (ja) 1987-04-08 1987-04-08 半導体装置の製造方法

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Publications (2)

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JPS63252433A JPS63252433A (ja) 1988-10-19
JPH0583180B2 true JPH0583180B2 (ja) 1993-11-25

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Family Cites Families (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6050949A (ja) * 1983-08-30 1985-03-22 Seiko Epson Corp 半導体装置
JPS6091660A (ja) * 1983-10-25 1985-05-23 Nec Corp 半導体装置の製造方法

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Publication number Publication date
JPS63252433A (ja) 1988-10-19

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