JPS617708A - カレントミラ−回路 - Google Patents
カレントミラ−回路Info
- Publication number
- JPS617708A JPS617708A JP12946984A JP12946984A JPS617708A JP S617708 A JPS617708 A JP S617708A JP 12946984 A JP12946984 A JP 12946984A JP 12946984 A JP12946984 A JP 12946984A JP S617708 A JPS617708 A JP S617708A
- Authority
- JP
- Japan
- Prior art keywords
- current
- transistor
- collector
- mirror circuit
- current mirror
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05F—SYSTEMS FOR REGULATING ELECTRIC OR MAGNETIC VARIABLES
- G05F3/00—Non-retroactive systems for regulating electric variables by using an uncontrolled element, or an uncontrolled combination of elements, such element or such combination having self-regulating properties
- G05F3/02—Regulating voltage or current
- G05F3/08—Regulating voltage or current wherein the variable is DC
- G05F3/10—Regulating voltage or current wherein the variable is DC using uncontrolled devices with non-linear characteristics
- G05F3/16—Regulating voltage or current wherein the variable is DC using uncontrolled devices with non-linear characteristics being semiconductor devices
- G05F3/20—Regulating voltage or current wherein the variable is DC using uncontrolled devices with non-linear characteristics being semiconductor devices using diode- transistor combinations
- G05F3/26—Current mirrors
- G05F3/265—Current mirrors using bipolar transistors only
Landscapes
- Engineering & Computer Science (AREA)
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- Nonlinear Science (AREA)
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明は、出力電流を入力電流と等しくする力 ゛
レントミラー回路、とくに半導体集積回路化されたカレ
ントミラー回路に関するものである。
レントミラー回路、とくに半導体集積回路化されたカレ
ントミラー回路に関するものである。
第１図に従来のカレントミラー回路を示す。第１図にお
いて、１は定電流源、２は第１のトランジスタ、３は第
２のトランジスタ、４は第３のトランジスタ、ｌＬ１２
は抵抗、１３は出力電流を出力するための出力端子、１
４はこのカレントミラー回路に電源を供給するための電
源端子、１５はアースである。このカレントミラー回路
は以上のように構成されており、トランジスタ２は、そ
のエミッタが抵抗１１を通して電源端子１４に接続され
、そのベースがトランジスタ３のベースおよびトランジ
スタ４のエミッタに接続され、そのコレクタがトランジ
スタ４のベースおよび定電流源１に接続され、トランジ
スタ３は、そのエミッタが抵抗１２を通して電源端子１
４に接続され、そのコレクタが出力端子１３に接続され
、トランジスタ４のコレクタはアース１５に接続されて
いる。
いて、１は定電流源、２は第１のトランジスタ、３は第
２のトランジスタ、４は第３のトランジスタ、ｌＬ１２
は抵抗、１３は出力電流を出力するための出力端子、１
４はこのカレントミラー回路に電源を供給するための電
源端子、１５はアースである。このカレントミラー回路
は以上のように構成されており、トランジスタ２は、そ
のエミッタが抵抗１１を通して電源端子１４に接続され
、そのベースがトランジスタ３のベースおよびトランジ
スタ４のエミッタに接続され、そのコレクタがトランジ
スタ４のベースおよび定電流源１に接続され、トランジ
スタ３は、そのエミッタが抵抗１２を通して電源端子１
４に接続され、そのコレクタが出力端子１３に接続され
、トランジスタ４のコレクタはアース１５に接続されて
いる。
ここで、入力電流１ｉに対する出力電流ＩＯの値を計算
すると、第１．第２および第３のトランジスタのベース
電流をｒ ｌｌ＋ １ ＠２およびｒｉ３とし、これ
らの電流増幅率ｈ−をｈＦＥＩ＋ ｈＦＥ！およびｈ
ｒｉ３とすれば次式が成立する。
すると、第１．第２および第３のトランジスタのベース
電流をｒ ｌｌ＋ １ ＠２およびｒｉ３とし、これ
らの電流増幅率ｈ−をｈＦＥＩ＋ ｈＦＥ！およびｈ
ｒｉ３とすれば次式が成立する。
１ｏ−１＋＋ （１＋＋＋ Ｔ ｓｚ） １１３
Ｔ ｓ、＝ （ｒｉ−１１３） ／ ｈ ｖｔ＋Ｔ Ｉ
Ｉｚ ＝ Ｔｏ／ ｈ ＦＥ２ Ｉｅｉ＝ （１，＋ Ｔｉ□−Ｉ ８３） ／ ｈ ｒ
ｉ３上の式において、ｒ１１＋＝１８２とするとＩｏ＝
Ｉｉ−Ｃ２１ｇ＋／ （１＋ ｈｒｔ＋） ）となるの
で、電流増幅率ｈＦＥが十分に大きければ出力電流Ｉｏ
は入力電流１ｉに殆んど一致する。しかしながら集積化
されたラテラルＰＮＰ ）ランジスタでは電流増幅率ｈ
ＦＥは小さく、ｈｒ！＋＝ｈＦＥｚ＝ｈｖｔｓ＝ ５と
してｉｏを計算すると、１ｏ＝０．９４１＋となり、出
力電流■０は入力電流１４より約６％減少する。その原
因は上の式から分かるようにベース電流の存在と電流増
幅率ｈｒｔが小さいことにある。
Ｔ ｓ、＝ （ｒｉ−１１３） ／ ｈ ｖｔ＋Ｔ Ｉ
Ｉｚ ＝ Ｔｏ／ ｈ ＦＥ２ Ｉｅｉ＝ （１，＋ Ｔｉ□−Ｉ ８３） ／ ｈ ｒ
ｉ３上の式において、ｒ１１＋＝１８２とするとＩｏ＝
Ｉｉ−Ｃ２１ｇ＋／ （１＋ ｈｒｔ＋） ）となるの
で、電流増幅率ｈＦＥが十分に大きければ出力電流Ｉｏ
は入力電流１ｉに殆んど一致する。しかしながら集積化
されたラテラルＰＮＰ ）ランジスタでは電流増幅率ｈ
ＦＥは小さく、ｈｒ！＋＝ｈＦＥｚ＝ｈｖｔｓ＝ ５と
してｉｏを計算すると、１ｏ＝０．９４１＋となり、出
力電流■０は入力電流１４より約６％減少する。その原
因は上の式から分かるようにベース電流の存在と電流増
幅率ｈｒｔが小さいことにある。
本発明は出力電流と入力電流との差をさらに小さくする
ためになされたものであり、その目的とするところは、
トランジスタのベース電流に帰因する出力電流の誤差を
減少させるようなカレントミラー回路を提供することに
ある。
ためになされたものであり、その目的とするところは、
トランジスタのベース電流に帰因する出力電流の誤差を
減少させるようなカレントミラー回路を提供することに
ある。
このような目的を達成するために本発明は、カレントミ
ラー回路に第４のトランジスタを設けることにより、ト
ランジスタのベース電流に帰因する出力電流の誤差を減
少せしめたものである。
ラー回路に第４のトランジスタを設けることにより、ト
ランジスタのベース電流に帰因する出力電流の誤差を減
少せしめたものである。
本発明を実施例に基づき詳細に説明する。第２図に本発
明に係わるカレントミラー回路の一実施例を示す。第２
図において、５は第４のトランジスタである。第２図に
おいて第１図と同一部分又は相等部分には同一符号が付
しである。このカレントミラー回路は以上のように構成
されており、トランジスタ５は、そのエミッタがトラン
ジスタ４のコレクタに接続され、そのベースがトランジ
スタ３のコレクタおよび出力端子１３に接続され、その
コレクタがアース１５に接続されている。
明に係わるカレントミラー回路の一実施例を示す。第２
図において、５は第４のトランジスタである。第２図に
おいて第１図と同一部分又は相等部分には同一符号が付
しである。このカレントミラー回路は以上のように構成
されており、トランジスタ５は、そのエミッタがトラン
ジスタ４のコレクタに接続され、そのベースがトランジ
スタ３のコレクタおよび出力端子１３に接続され、その
コレクタがアース１５に接続されている。
ここで、入力端子Ｉｔに対する出力電流１０の値を計算
すると、第１．第２．第３および第４のトランジスタの
ベース電流を１＋＋＋、Ｉ。、■６．および■お、とじ
、これらの電流増幅率ｈＦＥをｈＦＥＩ＋ ｈ Ｆｌ！
！＋ｈＦＥ！およびｈ ｒｉ４とすれば次式が成立する
。
すると、第１．第２．第３および第４のトランジスタの
ベース電流を１＋＋＋、Ｉ。、■６．および■お、とじ
、これらの電流増幅率ｈＦＥをｈＦＥＩ＋ ｈ Ｆｌ！
！＋ｈＦＥ！およびｈ ｒｉ４とすれば次式が成立する
。
１ｏ−Ｉｊ＋ （Ｉｅ＋ ｌ５ｚ）（１１１３１，）
Ｉｎ＋＝ （Ｉｉ −Ｉ Ｂ３） ／ ｈＦｔ＋Ｉ ｓ
ｚ＝ （ｉｏ−ｒ＋＋ｎ） ／ ｈｙｔｚ１１１３−（
Ｉｎ＋＋ ■。−１１１３） ／ ｈ ｙえ、１１１４
＝ （Ｔｌ１１ ＋４ａｃ １１３ １１Ｉ４） ／
ｈＦＥ４上の式において７１．Ｅ、＝ ｈＦＥ２＝ｈＦ
Ｅ３＝ｈ□４−５としてＩｏを計算すると、Ｉｏ＝０．
９８１ｉとなり、出力電流１ｏは入力電流１ｉより約２
％の減少となり、従来回路と比較して大幅に改善される
。
Ｉｎ＋＝ （Ｉｉ −Ｉ Ｂ３） ／ ｈＦｔ＋Ｉ ｓ
ｚ＝ （ｉｏ−ｒ＋＋ｎ） ／ ｈｙｔｚ１１１３−（
Ｉｎ＋＋ ■。−１１１３） ／ ｈ ｙえ、１１１４
＝ （Ｔｌ１１ ＋４ａｃ １１３ １１Ｉ４） ／
ｈＦＥ４上の式において７１．Ｅ、＝ ｈＦＥ２＝ｈＦ
Ｅ３＝ｈ□４−５としてＩｏを計算すると、Ｉｏ＝０．
９８１ｉとなり、出力電流１ｏは入力電流１ｉより約２
％の減少となり、従来回路と比較して大幅に改善される
。
なお、第１．第２のトランジスタのエミッタは、抵抗１
１．１２を通さずに直接電源端子１４に接続してもよい
。
１．１２を通さずに直接電源端子１４に接続してもよい
。
〔発明の効果〕
以上述べたように本発明は、カレントミラー回路に第４
のトランジスタを付加することによりベース電流の出力
電流に対する影響を少なくすることができるので、出力
電流の誤差を少なくすることができる効果がある。
のトランジスタを付加することによりベース電流の出力
電流に対する影響を少なくすることができるので、出力
電流の誤差を少なくすることができる効果がある。
第１図は従来のカレントミラー回路の回路図、第２図は
本発明に係わるカレントミラー回路の一実施例を示す回
路図である。 １・・・・定電流源、２，３，４．５・・・・トランジ
スタ、１１．１２・・・・抵抗、１３・・・・出力端子
、１４・・・・電源端子、１５・・・・アース。
本発明に係わるカレントミラー回路の一実施例を示す回
路図である。 １・・・・定電流源、２，３，４．５・・・・トランジ
スタ、１１．１２・・・・抵抗、１３・・・・出力端子
、１４・・・・電源端子、１５・・・・アース。
Claims (3)
- （１）出力電流が入力電流と等しくなるカレントミラー
回路において、第１、第２、第３および第４のトランジ
スタを具備してなり、第１のトランジスタは、そのエミ
ッタが電源端子に接続され、そのベースが第２のトラン
ジスタのベースおよび第３のトランジスタのエミッタに
接続され、そのコレクタが第３のトランジスタのベース
および定電流源に接続され、第２のトランジスタは、そ
のエミッタが電源端子に接続され、そのコレクタが第４
のトランジスタのベースおよび出力端子に接続され、第
３のトランジスタのコレクタは第４のトランジスタのエ
ミッタに接続され、第４のトランジスタのコレクタはア
ースに接続されたことを特徴とするカレントミラー回路
。 - （２）第１、第２のトランジスタは、そのエミッタが抵
抗を通して電源端子に接続されたことを特徴とする特許
請求の範囲第１項記載のカレントミラー回路。 - （３）第１、第２のトランジスタは、そのエミッタが直
接に電源端子に接続されたことを特徴とする特許請求の
範囲第１項記載のカレントミラー回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12946984A JPS617708A (ja) | 1984-06-22 | 1984-06-22 | カレントミラ−回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12946984A JPS617708A (ja) | 1984-06-22 | 1984-06-22 | カレントミラ−回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS617708A true JPS617708A (ja) | 1986-01-14 |
Family
ID=15010259
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12946984A Pending JPS617708A (ja) | 1984-06-22 | 1984-06-22 | カレントミラ−回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS617708A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0600475A3 (en) * | 1992-12-01 | 1995-01-25 | Nippon Electric Co | Constant current circuit provided with a base current compensation circuit. |
| JP2010501874A (ja) * | 2006-09-05 | 2010-01-21 | コンチネンタル オートモーティヴ ゲゼルシャフト ミット ベシュレンクテル ハフツング | 測定区間の端部に配置されている音波変換器を双方向で作動するための回路装置 |
-
1984
- 1984-06-22 JP JP12946984A patent/JPS617708A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0600475A3 (en) * | 1992-12-01 | 1995-01-25 | Nippon Electric Co | Constant current circuit provided with a base current compensation circuit. |
| JP2010501874A (ja) * | 2006-09-05 | 2010-01-21 | コンチネンタル オートモーティヴ ゲゼルシャフト ミット ベシュレンクテル ハフツング | 測定区間の端部に配置されている音波変換器を双方向で作動するための回路装置 |
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