JPS6222128A - デ−タ処理装置 - Google Patents

デ−タ処理装置

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JPS6222128A
JPS6222128A JP60163222A JP16322285A JPS6222128A JP S6222128 A JPS6222128 A JP S6222128A JP 60163222 A JP60163222 A JP 60163222A JP 16322285 A JP16322285 A JP 16322285A JP S6222128 A JPS6222128 A JP S6222128A
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signal
processing device
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浩史 前田
Tomikatsu Shiraishi
白石　富勝
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    • G06F—ELECTRIC DIGITAL DATA PROCESSING
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 く技術分野〉 本発明はクロック発振器の発振信号に応答して動作する
マイクロプロセッサを備え、当該マイクロプロセッサの
処理速度を切換え可能にしたデータ処理装置に関するも
のである。
〈従来技術〉 マイクロコンピュータ等にあって、低処理速度機向けに
開発されたゲームソフト等のプログラムを、高処理速度
機で実行すると、ゲーム操作キー等のキー操作が追従で
きなくなる。即ち、キー人力待ち時間が短くなって、キ
ー人力ができなくなる。　　゛ そのため、従来は、マイクロプロセッサのクロック周波
数を切替える方法が用いられていた空、それではハード
的に高価となってしまう。
〈発明の目的〉 本発明は上述した事項に鑑み、マイクロプロセッサの動
作周波数は一定に保ったまま、処理速度が変更可能とし
たデータ処理装置を提供することを目的とする。
〈実施例〉 以下、本発明の詳細な説明する。
本発明の実施例に係るデータ処理装置は、発振器の出力
を分周することにより、一定周期で割込み信号を発生さ
せ、当該割込み信号２回につき１回の割合で時間待ちル
ープを実行し、それによってマイクロプロセッサのみ７
３）けの処理速度を下げる構成とした。
第１図に本実施例のデータ処理装置の概略ブロックを示
す。
図中、１は主制御ユニットＣＰＵ（マイクロプロセッサ
）であり、図示しないＲＯＭ（リード・オンリ・メモリ
）に記憶するシーケンスプログラムによって制御動作を
行う。該シーケンスプログラムの一部を第２図及び第８
図に示す。
前記ＣＰＵＩは発振器２ふらクロック信号Ｃ１ｏｃｋ　
を受けて動作する。又、該ＣＰＵＩは前記クロック信号
を所定数分周する分周回路３７３１らのインターラブド
信号によって割込み処理へ移行する。この分周回路３の
出力は、予め決められた所定時間間隔でラッチ回路４に
供給される。その後、該ラッチ回路４は、インターラブ
ド（割込み）信号ｌＮＴＲを出力し、該インターラブド
信号をＣＰＵＩに供給する。
−ＣＰＵＩは、前記インターラブド信号によって割込み
処理可能時、インターラップアクノリッジ（割込認識）
信号ＩＮＴＡを出方して、前記ラッチ回路４をリセット
し、割込み処理へ移行したことを判定する。
又、このラッチ回路４は他のデバイスにも利用され、Ｃ
ＰＵＩへの割込み処理を起動させる。
５はキーボード装置であり、各種データ入カキ−、ファ
ンクションキーが設けられる。本実施例に関しては、カ
ーソルキー５ａ　、Ｓｅｔ　ｕｐキー５ｂ並びにスペー
スキー５ｃがある。
６は、ＬＣＤ（液晶）ディスブレイクの表示データを記
憶するビデオメモリである。
第２図について説明を行う。
データ処理装置に電源投入（Ｐｏｗｅｒ　　ｏｎ）が行
なわれるか、又は、Ｓｅｔ　ｕｐ　キー５ｂが操作され
ると（Ｓｏステップ）、シーケンスプログラムによって
予め決められたＳｅｔ　ｕｐメニューデータがビデオメ
モリ６に記憶され、ＬＣＤディスプレイ７に第４図のよ
うに表示が成される（Ｓ１ステツプ）。
操作者はカーソルキー５８を操作して、表示上のプロセ
ッサスピードＫ　更指示Ｗ　５１　ＧＣ力ｙ　ｉｖマー
ク５０を移動させる（ＳＺステップ）。すると、図示し
ないカーソルカウンタがカーソル位置に応じた値にカウ
ントを更新するＣ５３ステツプ）。
続いてスペースキー５ｃを操作すると（Ｓ４ステツプ）
、上記プロセッサスピード変更指示欄５１であるか判定
して（Ｓｓ　ステップ）、ｓｌｏｗ　フラッグがＯＮで
あれば該ｓｌｏｗフラッグをＯＦＦにしくＳｓ→Ｓ１ス
テップ）、それとは反対にｓｌｏｗフラッグがＯＦＦで
あれば該ｓｌｏｗフラッグをＯＮにする（Ｓ、→Ｓ８ス
テップ）。
その後、”ｓｌｏｗ”のメツセージデータ、若しくは”
５ｔａｎｄａｒｄ’のメツセージデータをビデオメモリ
６に書き込み（Ｓｅ及びＳ１０ステツプ）、当該メツセ
ージデータのいずれかをプロセッサスピード欄５２に表
示する。
所定のモード設定が完了すると、Ｓｅｔ　　ｕｐキー５
ｂを操作して、モード設定に応じた処理へと移行する。
インターラブドの割込み信号により、第３図の処理が実
行される。
割込み処理において、今まで処理して途中で紙えた各種
データを、ランダム・アクセス・メモリＲＡＭ（図示せ
ず〕へ特定エリアに記憶して、退避する（Ｎｌステップ
）。
次いで、割込み回数をカウントするカウンタが奇数であ
るか否か判定する（Ｎ、ステップ）。
上記Ｎ２ステップにおいて、判定した結果、カウントが
奇数であれば設定されたｓｌｏｗフラッグがＯＮである
か否７５．判定されるＣＮ３ステップ）。
もし、ｓｌｏｗフラッグがＯＮであると、Ｎ４ステツプ
のＷＨＩＴ処理（時間待ちループ）へと移行する。
ＷＡＩＴ処理は、予め決められた時間のウェイト処理を
行うために、プログラム処理によって、例えば所定ステ
ップのＮ０Ｐ（Ｎｏ　０ｐｅｒａｔｉｏｎ）命令を動作
させることによυ、ＷλＩＴ時間を作動させる（Ｎ４ス
テツプ）。
上記Ｎ２ステップにおける判定の結果、カウントが偶数
回であれば、通常の割込み処理又は直ちに割込み処理を
完了する（Ｎｓステップ）、。
上述の処理後、回数を１カウントアツプして（Ｎ８ステ
ツプ）、上記退避したＲＡＭのレジスタを再び処理する
ための復帰動作を行い、割込み動作が完了する（Ｎｙス
テップ）。
なお、上記実施例では、マイクロプロセッサＣＰＵの見
力）けの処理速度を基本と低速の２段階で切換可能とし
たが、低速の方を２段階以上にし処理速度の選択の幅を
広げることも考えられる。
例えば、割込み信号２回につき１回の割合で時間待ち処
理を行う場合と、割込み信号１０回につき１回の割合で
時間待ち処理を行う場合とを選択可能とすることが想到
される。
く効　果〉 以上の様に本発明によれば、クロック発振器の発振信号
に基づき動作するマイクロプロセッサを備えるデータ処
理装置において、前記クロック発振器の発振信号を分周
するごとにより一定周期で割込み信号を発生させる発生
手段と、前記マイクロプロセッサの処理速度の変更を指
示入力する入力手段と、前記入力手段の出力に応答して
、前記発生手段で発生する所定数の割込み信号につき１
回の割合で時間待ち処理を実行する制御部とを設けたか
ら、低速度処理のプログラムを、ハードウェアの追加を
行うことなく高速度処理でき、しかも、処理速度を、み
かけ上、任意に下げられるので、操作者は自分の操作能
力に応じてデータ処理を行うことが可能となる。
【図面の簡単な説明】
第１図は本発明の実施例に係るデータ処理装置のブロッ
ク構成図、第２図及び第３図は前記データ処理装置の処
理を示すフローチャート、第４図は前記データ処理装置
の表示内容を示す図である。 １・・・ＣＰＵ、２・・・発振器、３・・・分局回路、
４・・・ラッチ回路、５・・・キーボード装置、６・・
・ビデオメモリ、７・・・ＬＣＤディスプレイ。 代理人　弁理士福　士　愛　彦（他２名）第１図

Claims (1)

    【特許請求の範囲】
  1. １、クロック発振器の発振信号に基づき動作するマイク
    ロプロセッサを備えるデータ処理装置において、前記ク
    ロック発振器の発振信号を分周することにより一定周期
    で割込み信号を発生させる発生手段と、前記マイクロプ
    ロセッサの処理速度の変更を指示入力する入力手段と、
    前記入力手段の出力に応答して、前記発生手段で発生す
    る所定数の割込み信号につき１回の割合で時間待ち処理
    を実行する制御部とを設け、前記マイクロプロセッサの
    処理速度を切換えられる様にしたことを特徴とするデー
    タ処理装置。
JP60163222A 1985-07-22 1985-07-22 デ−タ処理装置 Granted JPS6222128A (ja)

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JP60163222A JPS6222128A (ja) 1985-07-22 1985-07-22 デ−タ処理装置
DE8686110006T DE3674307D1 (de) 1985-07-22 1986-07-21 Datenverarbeitungsanlage.
EP86110006A EP0215236B1 (en) 1985-07-22 1986-07-21 Data processing machine
US07/244,569 US4981296A (en) 1985-07-22 1988-09-12 Data processing machine with interrupt control for varying processing speed

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