JPH01307219A - 半導体装置の電極形成方法 - Google Patents

半導体装置の電極形成方法

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JPH01307219A
JPH01307219A JP13784388A JP13784388A JPH01307219A JP H01307219 A JPH01307219 A JP H01307219A JP 13784388 A JP13784388 A JP 13784388A JP 13784388 A JP13784388 A JP 13784388A JP H01307219 A JPH01307219 A JP H01307219A
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JP
Japan
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metal film
vacuum
silicon substrate
eutectic
temperature
Prior art date
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Pending
Application number
JP13784388A
Other languages
English (en)
Inventor
Shigeki Yamamoto
茂樹 山本
Yoshiyuki Koyama
小山 善行
Takayuki Nakai
中井 隆之
Masami Yokozawa
横沢 真覩
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electronics Corp
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は半導体装置、特に比較的大きな電力を扱う電力
用半導体装置の電極形成方法に関する。
従来の技術 従来、電力用半導体装置の電極形成方法としては、パワ
ートランジスタを例にして説明すれば、エミッタ及びベ
ース電極はアルミニウム蒸着膜が、また、コレクター電
極にはAu−3i合金またはニッケルバナジウムクロム
等の遷移金属が広く用いられていた。
電力用半導体装置の電極形成において留意すべき点は、
半導体装置の使用中、しばしば電極材料の乾腐食が発生
し熱抵抗を増大させたり、また断線不良を発生させたり
することを防ぐことが重要である。この現象は一般的に
「熱疲労現象」七呼ばれている。
特に樹脂封止型半導体装置においてはハーメチック型半
導体と比較して乾腐食が発生しゃすく信頼性を悪くして
いた。このような乾腐食を防ぐため、電極構造、電極材
料、封止材料、接着工程等の改善がなされている。
発明が解決しようとする課題 本発明は、乾腐食(熱疲労現象)を遅延させ高信頼性の
電力用半導体装置の電極形成方法を提供する。
従来、シリコン基板に電極を形成させる場合、シリコン
基板上に真空蒸着で金属膜を付着した後、次いで熱処理
を行い、共晶化もしくは化合させる方法が多い。この場
合真空蒸着後熱処理を施す迄に時間がかかり、表面が酸
化したり、取り扱い方で傷などを発生させ、均一な接着
力を得られない欠点があった。その為酸化している箇所
や傷などを基点として一層酸化が進行し乾腐食を促進さ
せていた。
課題を解決するための手段 このような問題点を解決するため、本発明では第一の金
属膜を真空蒸着によってシリコン基板上に付着させる際
、シリコン基板を340℃から400℃に高めておくこ
とにより、真空蒸着と同時に共晶化反応もしくは化合反
応をおこさせ、それによりシリコン基板と第一金属膜と
の間を強力にしようとするものである。金属膜は真空中
で気化されているため、活化されており状態図で示され
る共晶温度及び化合温度よりもかなり低温で共晶や化合
をおこすことができる。この後続けて第二の金属膜を真
空蒸着しリードフレームとのはんだづけを容易にさせる
のである。
従って第二の金属膜としてはニッケルや銀など、はんだ
材と接着しやすい金属が適する。
作用 本発明によると、低温で第一金属膜とシリコン基板との
合金化が達成され、安定性の高いコンタクト電極形成が
実現できる。
実施例 実施例1 パワートランジスタを例にして本発明の詳細な説明する
。
すでに全ての拡散処理が終了しエミッタ及びベースの各
電極にはアルミニウム膜を形成しであるシリコン基板を
真空蒸着槽内で340℃に加熱、Au−Ge合金(Ge
含有量15%)を厚み1.2μm蒸着させた。シリコン
と金の共晶温度は370℃であるが、340℃でも蒸着
中にシリコン基板と金とが共晶化反応をおこしているこ
とが、蒸着後の膜状態から理解できる。しかるのち第二
の金属膜としてクロム/クロムニッケル合金(Ni含有
量35%)/ニッケルをそれぞれ0.05μm、0.1
μm、0.3um連続蒸着した。
実施例2 実施例1と同じシリコン基板を400℃に加熱し、Au
−Ge−8b合金(Ge含有量15%。
sb含有量1.5%)を厚み2.0μm蒸着させた。し
かるのち第二の金属膜としてクロム/クロムニッケル合
金(Ni含有量35%)をそれぞれ0.05μm、0.
1μm、0.3μm連続蒸着した。
このように電極形成の終了した基板から各チップに分割
しP b / S nを用いてTO220型のリードフ
レームに接着した。ワイヤーボンド、次いで、樹脂封止
したのち、熱抵抗による乾腐食テストを行った。熱疲労
させる条件は、半導体チップ1:5W (1=5A、V
=IA)をオン/オフ5分の間欠的に印加した。(この
時の温度差は105℃であった。オン時130℃、オフ
時25℃)第1図には本発明法(実施例1及び2)と従
来法(第一の金属膜を基板150℃で真空蒸着したのち
400℃に加熱し共晶化させた後、次いで第二の金属膜
を付着形成させたもの)との熱疲労テスト結果を示す。
結果は熱抵抗の変化とオン/オフの間欠回数で示した。
従来法では約20000サイクルから熱抵抗が増加し、
劣化が観察されるのに対し、本発明法では全く熱抵抗の
劣化がない。明らかに熱疲労寿命が長いことがわかる。
発明の詳細 な説明したように本発明によれば、従来法に比較し、高
い信頼性の半導体装置を得るばかりか、作業工程(熱処
理を不要にした)の削減を図ることもでき、製造上利点
が多い。
【図面の簡単な説明】
第1図は本発の方法の効果を表す熱疲労テスト結果の特
性図である。 1・・・・・・実施例特性曲線、2・・・・・・従来例
′特性曲線。

Claims (1)

    【特許請求の範囲】
  1.  340℃から400℃に加熱したシリコン基板に、ま
    ず、第一の金属膜として少なくとも金とゲルマニウムを
    含む合金を真空蒸着して、蒸着中にシリコンと金の共晶
    化反応を起こさせる工程と、次いで第二の金属膜として
    少なくともニッケル単体、もしくはニッケルを含む合金
    を蒸着する工程とが構成されることを特徴とした半導体
    装置の電極形成方法。
JP13784388A 1988-06-03 1988-06-03 半導体装置の電極形成方法 Pending JPH01307219A (ja)

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Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS52144272A (en) * 1976-05-27 1977-12-01 Nec Home Electronics Ltd Forming method of electrode in semiconductor device
JPS5521186A (en) * 1978-08-03 1980-02-15 Mitsubishi Electric Corp Ohmic electrode material for p-type 3-5 families compound semiconductor and forming method of ohmic electrode
JPS6247150A (ja) * 1985-08-26 1987-02-28 Sumitomo Electric Ind Ltd 半導体装置およびその製造方法

Patent Citations (3)

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