JPH028233U - - Google Patents

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JPH028233U
JPH028233U JP8620288U JP8620288U JPH028233U JP H028233 U JPH028233 U JP H028233U JP 8620288 U JP8620288 U JP 8620288U JP 8620288 U JP8620288 U JP 8620288U JP H028233 U JPH028233 U JP H028233U
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  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)

Description

【図面の簡単な説明】
第１図はこの考案の１つの実施例に係るＰＬＬ
回路を示すブロツク図、第２図は第１図の動作を
示す説明図、第３図は他の実施例に係るＰＬＬ回
路を示すブロツク図、第４図は第３図のＰＬＬ回
路におけるＶＣＯ制御電圧と入力信号周波数との
関係を表す線図、第５図は第３図のマイクロコン
ピユータの動作を示すフローチヤート、第６図は
第３図の変形例におけるＶＣＯ制御電圧と入力信
号周波数との関係を示す線図、第７図は第３図の
変形例におけるマイクロコンピユータの動作を示
すフローチヤートである。 １０，２０：位相比較器、１２：ＬＰＦ、１４
：加算器、１６：ＶＣＯ、１８：シフト電圧発生
回路、２２：マイクロコンピユータ。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) 外部入力信号とＶＣＯ発振信号との位相差
    信号をＬＰＦで積分したあとＶＣＯへ制御電圧と
    して出力するＰＬＬ回路において、 ＬＰＦとＶＣＯ間にレベルシフト部を設け、 外部入力信号の周波数変化に応じてＬＰＦ出力
    をレベルシフトさせてＶＣＯへ出力すること、 を特徴とするＰＬＬ回路。 (2) アンロツク時にＬＰＦの出力を所定量レベ
    ルシフトさせてＶＣＯへ出力すること、 を特徴とする第１項記載のＰＬＬ回路。
JP1988086202U 1988-06-29 1988-06-29 Ｐｌｌ回路 Expired - Lifetime JP2503747Y2 (ja)

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JPH028233U true JPH028233U (ja) 1990-01-19
JP2503747Y2 JP2503747Y2 (ja) 1996-07-03

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Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS49120572A (ja) * 1973-03-16 1974-11-18
JPS59198028A (ja) * 1983-04-26 1984-11-09 Anritsu Corp 位相同期回路
JPS609204A (ja) * 1983-06-28 1985-01-18 Matsushita Electric Ind Co Ltd テレビジヨン信号の検波回路
JPS61288622A (ja) * 1985-06-17 1986-12-18 Victor Co Of Japan Ltd Ｐｌｌ装置
JPS623528A (ja) * 1985-06-28 1987-01-09 Casio Comput Co Ltd Ｐｌｌ発振器

Patent Citations (5)

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JP2503747Y2 (ja) 1996-07-03

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