JPH0351301B2 - - Google Patents
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- JPH0351301B2 JPH0351301B2 JP60011001A JP1100185A JPH0351301B2 JP H0351301 B2 JPH0351301 B2 JP H0351301B2 JP 60011001 A JP60011001 A JP 60011001A JP 1100185 A JP1100185 A JP 1100185A JP H0351301 B2 JPH0351301 B2 JP H0351301B2
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- semiconductor element
- semiconductor device
- semiconductor
- resin
- molding
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- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W74/00—Encapsulations, e.g. protective coatings
- H10W74/10—Encapsulations, e.g. protective coatings characterised by their shape or disposition
- H10W74/111—Encapsulations, e.g. protective coatings characterised by their shape or disposition the semiconductor body being completely enclosed
- H10W74/121—Encapsulations, e.g. protective coatings characterised by their shape or disposition the semiconductor body being completely enclosed by multiple encapsulations, e.g. by a thin protective coating and a thick encapsulation
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- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/071—Connecting or disconnecting
- H10W72/075—Connecting or disconnecting of bond wires
- H10W72/07541—Controlling the environment, e.g. atmosphere composition or temperature
- H10W72/07551—Controlling the environment, e.g. atmosphere composition or temperature characterised by changes in properties of the bond wires during the connecting
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- H10W72/00—Interconnections or connectors in packages
- H10W72/50—Bond wires
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- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
- H10W90/751—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires
- H10W90/756—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires between a chip and a stacked lead frame, conducting package substrate or heat sink
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- Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は半導体装置にかかるものであり、特に
モールド成形によつて半導体素子に加えられる応
力負荷に対して改良構造を有する半導体装置に関
するものである。
モールド成形によつて半導体素子に加えられる応
力負荷に対して改良構造を有する半導体装置に関
するものである。
半導体素子がモールド成形される半導体装置と
しては、例えば第3図に示すものがある。この図
において、半導体素子1は、まずフレーム2に固
着され、次に、ワイヤ3によつて各々対応するリ
ード部21に布線されて組立てられる。そして、
その後トランスフアモールド法等により、エポキ
シ樹脂4等で成形封止される。
しては、例えば第3図に示すものがある。この図
において、半導体素子1は、まずフレーム2に固
着され、次に、ワイヤ3によつて各々対応するリ
ード部21に布線されて組立てられる。そして、
その後トランスフアモールド法等により、エポキ
シ樹脂4等で成形封止される。
ところで、かかる成形封止において、成形後の
樹脂は、硬化後の冷却とともに通常収縮が生じ、
半導体素子1に対して大きな圧力を及ぼす。この
ため、半導体素子1の周縁部に欠陥が発生し、半
導体装置としての機能に支障が生ずるおそれがあ
る。
樹脂は、硬化後の冷却とともに通常収縮が生じ、
半導体素子1に対して大きな圧力を及ぼす。この
ため、半導体素子1の周縁部に欠陥が発生し、半
導体装置としての機能に支障が生ずるおそれがあ
る。
また、モールド用の樹脂4と半導体素子1は通
常熱膨張係数が一桁以上異なるため、半導体装置
の使用中すなわち動作中の温度変化により、いわ
ゆる熱応力が生ずることとなる。これらの応力
は、半導体素子1の周縁部が大きく、また、半導
体素子1の主表面に生ずる応力は大きくなる。
常熱膨張係数が一桁以上異なるため、半導体装置
の使用中すなわち動作中の温度変化により、いわ
ゆる熱応力が生ずることとなる。これらの応力
は、半導体素子1の周縁部が大きく、また、半導
体素子1の主表面に生ずる応力は大きくなる。
本発明は、かかる従来技術の欠点に鑑みてなさ
れたものであり、成形樹脂による半導体素子への
応力負荷を低減することができる半導体装置を提
供することを目的とする。
れたものであり、成形樹脂による半導体素子への
応力負荷を低減することができる半導体装置を提
供することを目的とする。
本発明は、樹脂材によつてモールド成形される
半導体素子の主表面の周縁部に軟質材からなる絶
縁性の環状冠帯を設けたことを特徴とするもので
ある。
半導体素子の主表面の周縁部に軟質材からなる絶
縁性の環状冠帯を設けたことを特徴とするもので
ある。
本発明によれば、半導体素子の周縁部に設けら
れた軟質材により樹脂材の熱変形による応力負荷
が吸収され、半導体素子に対する応力負荷が低減
される。
れた軟質材により樹脂材の熱変形による応力負荷
が吸収され、半導体素子に対する応力負荷が低減
される。
以下、本発明にかかる半導体装置を添付図面に
示す実施例に基づいて詳細に説明する。
示す実施例に基づいて詳細に説明する。
第1図には本発明にかかる半導体装置の一実施
例が示されている。また、第1図の破線部分が拡
大して第2図に示されている。なお、前述した従
来技術と同様の構成部分については同一の符号を
用いることとする。
例が示されている。また、第1図の破線部分が拡
大して第2図に示されている。なお、前述した従
来技術と同様の構成部分については同一の符号を
用いることとする。
第1図及び第2図において半導体素子1には、
その主表面にコート層5が形成されている。この
コート層5は基本的には半導体素子1の主表面の
周縁部のみに形成すればよいが、製造上の容易さ
からすれば主表面の全体に形成してよく、これに
よつて半導体素子1の機能に格別の障害が生ずる
ことはない。
その主表面にコート層5が形成されている。この
コート層5は基本的には半導体素子1の主表面の
周縁部のみに形成すればよいが、製造上の容易さ
からすれば主表面の全体に形成してよく、これに
よつて半導体素子1の機能に格別の障害が生ずる
ことはない。
次に半導体素子1の主表面の周縁部には、必要
とすれば切欠きを設けて、その部分に環状冠帯5
1が形成されている。この環状冠帯51は、例え
ばシリコン樹脂等の絶縁性軟質材が使用される。
この環状冠帯51は、スピンコート法あるいはス
クリーン印刷法等を用いてコート層5と同時に形
成される。形成後、ウエハ上の多数の半導体素子
を分割するダイシング工程により切断されて、各
半導体素子1毎に環状冠帯51が形成されること
となる。52はダイシング時に形成されたダイシ
ング面である。このように、環状冠帯51は半導
体素子1と一体構成され、その後に樹脂4による
モールド工程が行われるようになつている。した
がつて、モールドは第3図の従来例の場合と同様
に、極めて簡単に例えば1挙動で実施できる利点
がある。
とすれば切欠きを設けて、その部分に環状冠帯5
1が形成されている。この環状冠帯51は、例え
ばシリコン樹脂等の絶縁性軟質材が使用される。
この環状冠帯51は、スピンコート法あるいはス
クリーン印刷法等を用いてコート層5と同時に形
成される。形成後、ウエハ上の多数の半導体素子
を分割するダイシング工程により切断されて、各
半導体素子1毎に環状冠帯51が形成されること
となる。52はダイシング時に形成されたダイシ
ング面である。このように、環状冠帯51は半導
体素子1と一体構成され、その後に樹脂4による
モールド工程が行われるようになつている。した
がつて、モールドは第3図の従来例の場合と同様
に、極めて簡単に例えば1挙動で実施できる利点
がある。
次に上記実施例の作用について説明すると、環
状冠帯51は、軟質材によつて形成されているた
め、モールド用の樹脂4による応力負荷を吸収す
ることができる。従つて半導体素子1に対する応
力負荷が低減されることとなる。
状冠帯51は、軟質材によつて形成されているた
め、モールド用の樹脂4による応力負荷を吸収す
ることができる。従つて半導体素子1に対する応
力負荷が低減されることとなる。
なお、半導体素子1の大きさは、どのようなも
のであつてもよいが、特にLSIなどの比較的大型
のものに対しては、特に効果が大きい。
のであつてもよいが、特にLSIなどの比較的大型
のものに対しては、特に効果が大きい。
以上説明したように、本発明による半導体装置
によれば、半導体素子の周縁部に軟質材からなる
環状冠帯を設けることとしたので、モールド材に
よる応力負荷を低減することができ、半導体素子
の機能が損なわれるおそれがなく信頼性の向上を
図ることができるという効果がある。
によれば、半導体素子の周縁部に軟質材からなる
環状冠帯を設けることとしたので、モールド材に
よる応力負荷を低減することができ、半導体素子
の機能が損なわれるおそれがなく信頼性の向上を
図ることができるという効果がある。
第1図は本発明にかかる半導体装置の一実施例
を示す断面図、第2図は第1図の破線部分を拡大
して示す拡大図、第3図は従来の半導体装置の一
例を示す断面図である。 図において、1は半導体素子、2はフレーム、
3はワイヤ、4は樹脂、5はコート層、21はリ
ード部、51は環状冠帯、52はダイシング面で
ある。なお、各図中同一符号は、同一又は相当部
分を示すものとする。
を示す断面図、第2図は第1図の破線部分を拡大
して示す拡大図、第3図は従来の半導体装置の一
例を示す断面図である。 図において、1は半導体素子、2はフレーム、
3はワイヤ、4は樹脂、5はコート層、21はリ
ード部、51は環状冠帯、52はダイシング面で
ある。なお、各図中同一符号は、同一又は相当部
分を示すものとする。
Claims (1)
- 【特許請求の範囲】 1 半導体素子を樹脂材のモールド成形により封
止してなる半導体装置において、 前記半導体素子はその主表面側の周縁部に軟質
絶縁材からなる環状冠帯を有することを特徴とす
る半導体装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60011001A JPS61171156A (ja) | 1985-01-25 | 1985-01-25 | 半導体装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60011001A JPS61171156A (ja) | 1985-01-25 | 1985-01-25 | 半導体装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61171156A JPS61171156A (ja) | 1986-08-01 |
| JPH0351301B2 true JPH0351301B2 (ja) | 1991-08-06 |
Family
ID=11765886
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60011001A Granted JPS61171156A (ja) | 1985-01-25 | 1985-01-25 | 半導体装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61171156A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP4675146B2 (ja) * | 2005-05-10 | 2011-04-20 | パナソニック株式会社 | 半導体装置 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS413776Y1 (ja) * | 1964-03-03 | 1966-02-28 |
-
1985
- 1985-01-25 JP JP60011001A patent/JPS61171156A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61171156A (ja) | 1986-08-01 |
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