JPH0473962A - 半導体装置 - Google Patents
半導体装置Info
- Publication number
- JPH0473962A JPH0473962A JP2187650A JP18765090A JPH0473962A JP H0473962 A JPH0473962 A JP H0473962A JP 2187650 A JP2187650 A JP 2187650A JP 18765090 A JP18765090 A JP 18765090A JP H0473962 A JPH0473962 A JP H0473962A
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- Japan
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- layer
- semiconductor layer
- transistor
- type semiconductor
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Links
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- 238000009792 diffusion process Methods 0.000 claims description 13
- 239000002184 metal Substances 0.000 abstract description 7
- 230000003071 parasitic effect Effects 0.000 abstract description 6
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 229910052710 silicon Inorganic materials 0.000 description 2
- 239000010703 silicon Substances 0.000 description 2
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- 229920006395 saturated elastomer Polymers 0.000 description 1
Landscapes
- Bipolar Transistors (AREA)
- Bipolar Integrated Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は半導体装置に関し、特にバイポーラ型NPN
トランジスタを含む半導体集積回路に関するものである
。
トランジスタを含む半導体集積回路に関するものである
。
従来技術による半導体装置について、平面図である第3
図と、第3図のA−B断面図である第4図とを参照して
説明する。
図と、第3図のA−B断面図である第4図とを参照して
説明する。
N型半導体層1にP型拡散層2が形成され、さらにN型
拡散層3,3aが形成され、絶縁膜4が形成され、絶縁
膜4に開口5.5a、5cが形成され、金属電極6.6
a、6cが形成されて、それぞれコレクタ、ベース、エ
ミッタを構成している。
拡散層3,3aが形成され、絶縁膜4が形成され、絶縁
膜4に開口5.5a、5cが形成され、金属電極6.6
a、6cが形成されて、それぞれコレクタ、ベース、エ
ミッタを構成している。
半導体集積回路においてはP型シリコン基板にN型埋込
層が形成され、その上にN型エピタキシャル層を成長さ
れ、N型エピタキシャル層にバイポーラ型NPN)ラン
ジスタが形成されている。
層が形成され、その上にN型エピタキシャル層を成長さ
れ、N型エピタキシャル層にバイポーラ型NPN)ラン
ジスタが形成されている。
そのため第5図の等価回路に示すように、本体のNPN
トランジスタ7の飽和領域では、寄生PNPトランジス
タ8の作用が生じてベース電流がP型シリコン基板に流
れ出すという欠点があった。
トランジスタ7の飽和領域では、寄生PNPトランジス
タ8の作用が生じてベース電流がP型シリコン基板に流
れ出すという欠点があった。
本発明の目的は、寄生PNP)ランジスタ作用が生じな
い半導体装置を提供することにある。
い半導体装置を提供することにある。
本発明の半導体装置は、第1のN型半導体層にP型半導
体層が形成され、P型拡散層に2個のN型拡散層が形成
され、N型拡散層の内、一方をバイポーラトランジスタ
のコレクタとし、他方をバイポーラトランジスタのエミ
ッタとしたバイポーラトランジスタを含んでいる。
体層が形成され、P型拡散層に2個のN型拡散層が形成
され、N型拡散層の内、一方をバイポーラトランジスタ
のコレクタとし、他方をバイポーラトランジスタのエミ
ッタとしたバイポーラトランジスタを含んでいる。
本発明の第1の実施例について、平面図である第1図と
、第1図のA−B断面図である第2図とを参照して説明
する。
、第1図のA−B断面図である第2図とを参照して説明
する。
N型半導体層1にP型拡散層2を形成し、さらにN型拡
散層3.3a、3bを形成し、絶縁膜4を形成し、絶縁
11j4に開口5.5a、5b; 5cを形成し、金属
電極5.6a、6b、6cを形成する。
散層3.3a、3bを形成し、絶縁膜4を形成し、絶縁
11j4に開口5.5a、5b; 5cを形成し、金属
電極5.6a、6b、6cを形成する。
金属電極6a、6b、6cをそれぞれエミッタ、コレク
タ、ベースとし、金属電極6を最高電位にバイアスする
。
タ、ベースとし、金属電極6を最高電位にバイアスする
。
本発明の半導体集積回路用NPN型バイポーラトランジ
スタは横型トランジスタで、ベース層を構成しているP
型拡散層は、最高電位にバイアスしたN型半導体層から
分離されている。
スタは横型トランジスタで、ベース層を構成しているP
型拡散層は、最高電位にバイアスしたN型半導体層から
分離されている。
そのため飽和状態においても寄生PNP)ランジスタ作
用を解消することができた。
用を解消することができた。
横型トランジスタにおいては、エミッターコレクタ間の
距離を制御することにより、hFEをコントロールする
ことができる。
距離を制御することにより、hFEをコントロールする
ことができる。
さらにエミッタ電極とコレクタ電極とを入れ替えても、
同一の特性が得られるのでパターン配置の自由度が大き
くなった。
同一の特性が得られるのでパターン配置の自由度が大き
くなった。
第1図は本発明の一実施例を示す平面図、第2゛図は第
1図のA−B断面図、第3図は従来技術による半導体装
置を示す平面図、第4図は第3図のA−B断面図、第5
図は寄生PNP)ランジスタを示す等価回路図である。 1・・・N型半導体層、2・・・P型拡散層、3,3a
、3b−−−N型拡散層、4川絶縁膜、5.5a。 5b、5ic・−開口、6 、6 a 、 6 b 、
6 c−金属電極、7・・・NPN)ランジスタ、8
・・・寄生PNPトランジスタ。
1図のA−B断面図、第3図は従来技術による半導体装
置を示す平面図、第4図は第3図のA−B断面図、第5
図は寄生PNP)ランジスタを示す等価回路図である。 1・・・N型半導体層、2・・・P型拡散層、3,3a
、3b−−−N型拡散層、4川絶縁膜、5.5a。 5b、5ic・−開口、6 、6 a 、 6 b 、
6 c−金属電極、7・・・NPN)ランジスタ、8
・・・寄生PNPトランジスタ。
Claims (1)
- 第1のN型半導体層にP型半導体層が形成され、該P
型拡散層に2個のN型拡散層が形成され、該N型拡散層
の内、一方をバイポーラトランジスタのコレクタとし、
他方を前記バイポーラトランジスタのエミッタとするこ
とを特徴とする半導体装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2187650A JPH0473962A (ja) | 1990-07-16 | 1990-07-16 | 半導体装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2187650A JPH0473962A (ja) | 1990-07-16 | 1990-07-16 | 半導体装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0473962A true JPH0473962A (ja) | 1992-03-09 |
Family
ID=16209818
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2187650A Pending JPH0473962A (ja) | 1990-07-16 | 1990-07-16 | 半導体装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0473962A (ja) |
-
1990
- 1990-07-16 JP JP2187650A patent/JPH0473962A/ja active Pending
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